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SOC/ASIC/FPGA驗證方法學5-UVM事務級建模

5.0共3個課時47人已學習

講師:William    資深IC驗證工程師

SOC/ASIC/FPGA驗證方法學5-UVM事務級建模 專欄課程 3個課時

  • SOC/ASIC/FPGA驗證方法學5-UVM事務級建模專欄介紹

    UVM是Universal Verification Methodology的簡稱,即通用驗證方法學。該課程講解了用于設計驗證的UVM驗證方法學的基礎知識,是學習UVM的入門課程,為以后深入學習UVM打下基礎。通過在課程當中加入實例的方法來逐步的學習搭建UVM測試平臺的每一個過程,真正的實現將知識點與實際的代碼相結合,使得課程內容直觀容易理解。通過對本課程的學習,可以勝任大部分的UVM驗證平臺的工作。



    本課程能給您帶來什么?

    通過對本課程的學習,可以熟練搭建并使用UVM測試平臺,并勝任大部分的UVM驗證平臺的工作。


    適合人群:

    本課程適合于從事芯片驗證的學生和工程師

    參加學習的學員應有一定的System Verilog語言基礎

    具有System Verilog驗證方法學有一定基礎的學員可以更輕松的學習該課程。




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